[其他]盒式存儲磁帶機和數據處理設備無效
| 申請號: | 87107950 | 申請日: | 1987-11-19 |
| 公開(公告)號: | CN87107950A | 公開(公告)日: | 1988-06-01 |
| 發明(設計)人: | 中西美彰;中川克也 | 申請(專利權)人: | 任天堂株式會社 |
| 主分類號: | G06F12/00 | 分類號: | G06F12/00 |
| 代理公司: | 中國專利代理有限公司 | 代理人: | 吳增勇,吳秉芬 |
| 地址: | 日本京都*** | 國省代碼: | 暫無信息 |
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| 摘要: | |||
| 搜索關鍵詞: | 盒式 存儲 磁帶機 數據處理 設備 | ||
本發明涉及一種盒式存儲磁帶機。更準確地說,本發明涉及一種可附裝到一數據處理部件(例如通過連接到一標準電視接收機而使用的家用視頻游戲機)上、并可從該數據處理部件上卸下的盒式存儲磁帶機,而該盒式存儲磁帶機在使用時是裝入該數據處理部件中的。
我們把由本發明申請人所制造并銷售的、被稱為“家庭計算機”(商標)或“寧坦多(Nintendo)娛樂系統”(商標)的視頻游戲機和被稱為“MSX”(商標)的個人計算機作為例子來對該數據處理部件(在該部件中是靠一電視接收機來顯示圖象的)進行說明。這些數據處理部件都是通過裝入一個已被預先寫入有游戲程序軟件、教育軟件等的外部盒式存儲磁帶機而正常操作的。該盒式存儲磁帶機中容有用于存儲程序數據和(用于顯示的)字符數據的只讀存儲器(ROM)。
關于如上所述的盒式存儲磁帶機,最近,有時其內裝有擁有更大容量(例如/兆比特或4兆比特)的存儲器。在使用這樣一種大容量存儲器的情況下,由于數據處理部件中可由中央處理器存取的地址空間是有限的,所以必須使用所謂“轉換存儲單元組”的方法。
按照慣例,從第4,432,067號美國專利已經得知一種攷慮到被連接到數據處理機的各地址線的數目,也就是,地址空間保持在某一預定數的情況下來擴充存儲器的容量的方法。該專利公開了一種包含地址譯碼器、鎖存器電路、附加的存儲器芯片以及用于選擇存儲器芯片的信號線的盒式存儲磁帶機。
在第4,432,067號美國專利中,其地址譯碼器在某一地址數據變成指明該存儲器芯片必須轉換的專用地址時檢測出一種定時信號,然后就由其鎖存器電路和信號線轉換該存儲器芯片。這就意味著該存儲器芯片的轉換是由某一專用硬件電路和僅僅被預接好的存儲器芯片插座所控制的。因此就不可能轉換任意內存大小的存儲單元組。此外,由于只能實行固定不變地由所述硬件電路所確定的轉換,所以在設計游戲機等類設備的程序中就有許多限制。
因此,本發明的主要目的是提供一種允許轉換任意內存大小的存儲單元組的盒式存儲磁帶機。
本發明的另一個目的是要提供一種能由數據處理器的某一程序來轉換各存儲單元組的盒式存儲磁帶機,因而可提高其程序設計的靈活性。
本發明還有一個目的是要提供一種能夠增加作為一個外部存儲器容量的盒式存儲磁帶機。
簡言之,按照本發明的盒式存儲磁帶機可從包括一微處理器的數據處理部件上插、卸、并在使用時被裝入該數據處理部件中;它包括:一塊一經裝入就連接到數據處理部件的印刷電路板,一個被裝在該印刷電路板上的、而且其存儲區被分成許多存儲單元組的存儲器以及被裝在該印刷電路板上、并接收從所述微處理器給定的代表轉換存儲單元組的各條件的數據、并給出某一用于對該存儲器規定某一存儲單元組的地址的存儲器控制裝置;該存儲器控制裝置包括:接收來自所述微處理器的所述數據的許多寄存器以及用于根據所述許多寄存器的數據而產生所述地址的地址發生裝置。
當該盒式存儲磁帶機被裝入該數據處理部件時,該印刷電路就被連接到該數據處理部件,于是包括盒式存儲磁帶機和該數據處理部件的系統便允許操作了。代表各轉換存儲單元組各條件的數據是從被包括在數據處理部件中的微處理器給出到該盒式存儲磁帶機的。根據這數據,存儲器控制裝置就向該存儲器給出某一對應于所要選定的存儲單元組的地址。因此,該存儲器的被選定的存儲單元組就被直接根據該數據處理部件的微處理器存取。
按照本發明,其存儲器控制裝置根據來自數據處理機的微處理器的數據給出為存儲器存儲單元組的轉換所用的地址,因而通過變更來自微處理器的數據就可有選擇地使任一存儲單元組能操作。因此,通過使微處理器正確地變更它的維護該程序步進程的數據,結果可使存儲器的存儲單元組能夠按照程序而執行轉換。為此,按照本發明的盒式存儲磁帶機,與只由硬件電路來進行轉換存儲單元組的傳統的盒式存儲磁帶機相比,能夠突出地改進設計或使用程序的靈活性。
本發明的這些目的和其它目的、特性、信號方式以及優點將可結合附圖,從下列的本發明各實施例的詳細說明中了解清楚。
圖1是表示根據本發明的一個實施例的部件分解透視圖。
圖2是表示圖1的實施例所適用的數據處理部件的例子的框圖。
圖3是表示圖1實施例的部件配置的框圖。
圖4是多存儲器控制器(MMC)的平面圖。
圖5是圖4所示的MMC的框圖。
圖6是按照圖5所示的MMC框圖的電路圖。
圖7A和7B是表示中央處理器(CPU)的地址空間的圖解。
圖8是表示外圍處理設備(PPU)的地址空間的圖解。
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