[其他]彩色信號階躍增陡電路無效
| 申請號: | 86101799 | 申請日: | 1986-03-20 |
| 公開(公告)號: | CN86101799A | 公開(公告)日: | 1986-10-15 |
| 發明(設計)人: | 彼得·邁克爾·弗拉姆;羅夫·迪尤伯特 | 申請(專利權)人: | 德國ITT工業有限公司 |
| 主分類號: | H04N9/77 | 分類號: | H04N9/77 |
| 代理公司: | 中國國際貿易促進委員會專利代理部 | 代理人: | 陸麗英 |
| 地址: | 聯邦德國弗*** | 國省代碼: | 暫無信息 |
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| 摘要: | |||
| 搜索關鍵詞: | 彩色 信號 階躍 電路 | ||
本發明涉及一種用于彩色電視接收機的彩色信號階躍增陡電路。它包括一個斜率檢測器,當信號超過某一預定的幅度閾值時,斜率檢測器就發出一個切換信號使兩個色差信道在其系統上升期間分別輸出一個替代信號。這種能改善彩色信號階躍的電路在VALVO發表的題為“技術信息840228(即1984年2月28日):采用TDA4560電路延遲彩色信號和亮度信號以增陡斜度”一文中已予說明。
色差信道帶寬要比亮度信道帶寬窄得多,目前采用的電視標準規定約為亮度信道帶寬的1/5。這就導致在彩色信號突變時造成彩色階躍模糊不清(稱為“彩色鑲邊”),例如在彩條測試信號的邊沿處可以看到,這是因為與其在一起的亮度信號相比,其傳輸通帶太窄,而彩色信號階躍約需五倍的持續時間,所以會產生上述情況。先有技術電路使彩色信號的慢升沿變陡主要是由于應用了適當的模擬電路(因為色差信號和亮度信號往往是以模擬信號的形式出現并予以處理的),通過適當地延遲色差信號和亮度信號,并在延遲終了時將色差信號的邊沿增陡的途徑來實現的。
本發明要解決的問題就是以下述方式來修改先有技術應用模擬電路的原則,即在現有的彩色電視接收機中采用帶有斜率檢測器的數字信號處理電路(參閱“電子學”1981年8月11日第9至103頁),它不僅符合先有技術電路所符合的有某一預定的幅度閾值的標準,而且還符合另一附加的標準。
遠在解決此問題所具有的優點以外的其它一些優點將從以下本發明的說明并結合附圖就會看得更清楚。
圖1是本發明的第一實施例的方框圖。
圖2是圖1實施例改進電路的方框圖。
圖3是圖1和圖2的斜率檢測器的實施方框圖。
圖4示出說明本發明基本工作的各種波形圖。
圖5示出說明圖2改進電路工作的各種波形圖。
參見圖1,數字色差信號yr、yb是以時鐘信號f(它是彩色信號副載波頻率的四倍)的頻率在基帶中出現,也就是說,各數據字以此頻率一個接一個地出現。如果時鐘信號f的次諧波(即此彩色副載波頻率自身就是一例)被選作色差信號的解調頻率,就象現有的數字彩色電視機那樣,這些數字信號必須用數字內插法帶到上述時鐘信號f的重復頻率上。
圖1中有二個分別為色差信號yr、yb設置的分路,這兩個分路設計得完全相同。Z1分路為色差信號R-Y信道,Z2分路為色差信號B-Y信道。在Z1分路里,R-Y色差信號yr被送到第一延遲部件v1和第一數字斜率檢測器fs1的輸入端。第一延遲部件v1的輸出端連到第一存儲器s1和第一開關us1的輸入端,而第一存儲器s1的輸出端連到第一開關us1的另一個輸入端。us1的輸出端連到第一輸出寄存器r1的輸入端。
就各個分路的各種電路及其各電路的相互連接而言,B-Y色差信號yb用的第二分路Z2設計得與第一分路z1完全相同,它包括第二數字斜率檢測器fs2、第二延遲部件v2,第二存儲器s2、第二開關us2和第二輸出寄存器r2。
二個斜率檢測器fs1、fs2的輸出信號分別送到“或”門og的第一、第二輸入端,“或”門og的輸出端連到程序控制器ab的第一輸入端。后者的第二輸入端是時鐘信號f,其第三輸入端是數字信號hz,用此信號可將保持時間預置得等于色差信道系統的上升時間。程序控制器ab的輸出端連到第一、第二存儲器s1、s2和第一、第二輸出寄存器r1、r2的“許可”輸入端en,還連接到二個開關us1、us2的控制輸入端。
程序控制器ab這樣控制這些子電路,在保持時間內某一中間值時出現的R-Y信號值yr1和B-Y信號值yb1分別被讀入存儲器s1和s2。此保持時間的中間值最好是處于保持時間的正中。此外,在增陡前沿相應于此中間值處,最好是在其半幅值處,程序控制器將存儲器s1和s2的存儲內容分別經過相關的開關us1和us2送入相關的輸出寄存器r1和r2,而除了在此增陡前沿中間值的瞬間以外的全部時間,相關的輸出寄存器r1、r2的輸入端則一直分別接在延遲部件v1和v2的輸出端上。
圖2的方框圖示出圖1實施例的改進電路,實際上改進部分主要包括:圖1中的第一、第二存儲器s1、s2又補充了第三、第四存儲器s3、s4,s3、s4分別地與相關的存儲器s1、s2并聯連接;圖1中的二個開關us1、us2擴展成多位開關us1′、us2′,每個開關附加一位,其輸入端分別連到第三存儲器s3和第四存儲器s4的輸出端。
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